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最新StarCore DSP内核加强了无线多媒体和modem处理性能

2004-07-30   来源:互联网   点击:
为了加强无线多媒体和modem处理能力,StarCore LLC在其最新版的DSP架构中增加了25条新指令、一个部分互锁管道、存储器保护和一个扩展了的中断机制。 StarCore表示,这些改进措施为生成更紧凑的应用代码、更高效

为了加强无线多媒体和modem处理能力,StarCore LLC在其最新版的DSP架构中增加了25条新指令、一个部分互锁管道、存储器保护和一个扩展了的中断机制。

StarCore表示,这些改进措施为生成更紧凑的应用代码、更高效的视频编解码处理、以及在系统级芯片(SoC)设计中支持更多外设铺平了道路。ALT="图:SC2000内核每周期可存取2×64位的数据">

在最近于美国加州圣何塞举行的2004年嵌入式处理器论坛上,StarCore宣布:SC2000内核将继续采用其V4架构,但增加了一个6级管道和动态分支预测。尽管无线应用是其首要目标,但该新架构和内核也针对融合型消费电子、有线通信、语音处理和通用DSP应用。

由于StarCore LLC正计划在今年晚些时候宣布其V5架构和在明年初推出其SC3000内核,该公司将在不到2年半的时间内推出3个架构系列,StarCore LLC行销副总裁Alex Bedarida说。

StarCore LLC成立于一年半以前,它是Agere和摩托罗拉的合资企业。该公司将它开发的架构转变成了一个可综合的内核,并于去年10月宣布向市场推出这一产品。该内核有2个版本:带2个乘法累加器(MAC)的SC1200和4个MAC的SC1400。“从那时开始,公司业务一直在高速发展之中,”Bedarida透露。

SC1000内核基于V2架构。V1和V3架构是Freescale公司(前身是摩托罗拉半导体公司)独有的版本,这2种架构在StarCore LLC成立前就已经完成开发或正在开发之中。不过,包括V4在内的所有这些版本都是代码向后兼容的,Bedarida表示。

通用架构的信号处理和控制代码处理能力使其能执行DSP和微控制器两种功能,Bedarida指出。其它方面包括:一个16到128位可变长度指令执行集(VLES),每周期可执行6条指令;一个带5级管道的超长指令字架构;以及界面友好的编译器。

“友好的编译器十分重要,因为我们不单单在讨论单循环程序,对于像手机或通信基础设施等应用来说,我们必须编写含有上万条代码的协议堆栈和其它功能程序。”Bedarida表示,“现在,你不仅可以编写纯控制类代码,而且还可以编写代码密度媲美ARM的需进行大量运算的DSP应用代码。”

V4架构的目标是进一步增加代码密度并使编译更容易,同时也降低功耗和增强视频处理能力。StarCore为此增加了25条新指令,其中一些指令以软件形式完成视频编解码处理。

例如,Bedarida举例说,每个周期允许执行高达4条绝对差分和(SAD4)指令,可使运动估算的速度提高13倍。

该内核还引入了一个部分管线互锁功能,Bedarida表示,它减少了编码约束的数量,并使编译和汇编级编程更高效。特权模式和存储器保护功能的增加提高了操作系统支持。

源生于V4架构的SC2000内核通过把“分派和解码”级裂分为两级,使管道从5级变为6级。Bedarida表示,不严格的时序要求允许实现更高的工作频率。动态分支预测机制减少了非循环流变状态下的等待时间,堆栈指针预估算功能减少了变址寻址指令的执行周期数。

Bedarida说,在SC2000上运行SC100代码所需的周期数减少了多达17%。新内核现已可供货。

作者:柏万宁


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